【政府補助】晶片至系統電磁相容實務

開課日期:2020-09-05 課程費用:7000
上課時間:週六 / 上午,下午 學習時程:21小時
上課地點: 台北市大安區基隆路3段130號 map
適用對象:
*【在職人士】本課程培訓之對象係為半導體、IC設計與封測、電機、電子、車用與通訊相關產...看完整
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課程特色
本課程內容涵蓋電磁干擾與靜電放電基礎原理、模擬軟體與EMI量測及除錯、以及EMC設計之實務相關議題(如:EMI根因分析:EMI雜訊分析、EMI 耦合路徑分析、元件非理想特性之效應、SI與PI所引起之EMI問題及其設計技術、射頻干擾(RFI)與共存(Coexistence)設計分析、IC-EMC分析與設計、EMI相關模擬軟體實務(操作)、電磁相容設計與除錯實務、硬體量測技術),以及ESD之國際規範及產業規範、產品解析除錯、ESD設計之實務相關議題(如:元件級ESD元件和電路設計原理分析、和系統級ESD設計原理、問題防制機制、ESD相關模擬方法介紹),讓學員建立元件至系統層級電路設計之完整EMC問題分析及其解決方案技術。
詳細內容

一、系統層級之電磁相容分析與設計技術

1. 電磁干擾效應之雜訊源與耦合路徑分析

2. 系統整合之電磁干擾現象與根因分析

3. 無線通訊系統之射頻干擾效應分析

4. 車載電子之EMC設計問題分析

5. 電磁相容問題之除錯與設計

6. 電磁干擾設計案例分析

二、晶片層級之電磁相容技術及其系統整合應用實務

1. 從晶片至系統層級之電磁相容設計策略與技術

2. 晶片層級IC-EMC (EMI、EMS、Transient)相關標準法規與量測技術分析

3. 系統整合之IC-EMC限制值規劃與RFI雜訊概算之應用

4. IC-EMC設計準則分析

5. IC層級EMC設計技術之案例分析

三、靜電放電ESD之法規與設計實務

1.元件級靜電放電設計

1.) 靜電放電之原理與元件級靜電放電之測試法規

2.) 靜電放電之國際規範及面板產業之靜電規範

3.) 靜電放電之元件和電路設計原理

2.系統級靜電放電簡介

1.) 系統級靜電放電之測試法規

2.) 系統級I/O靜電放電之測試與設計原理

3.) 系統級靜電之TVS元件簡介與防護方式

3.靜電放電設計流程驗證與量測和模擬方法

1.) 晶片之靜電放電設計流程與驗證

2.) 靜電放電之新型量測與模擬方法

四、靜電放電(ESD)模擬分析

1. PCB Model Extraction by SIwave

2. ESD Waveform Modeling for ESD Gun with Designer

3. ESD Protection Analysis with Diode Implementation

五、電磁干擾模擬分析

1. Simulation EMI with differential and common mode issue in FEM tools

2. Simulation EMI with discontinuities effect in FEM tools

3. PI/SI/EMI co-simulation with CPM model

4. Real case study

 

師資介紹
 【課程規劃】
國立台灣大學 電機系 吳瑞北 特聘教授
逢甲大學 通訊工程系 林漢年教授
【課程講師】

林漢年   逢甲大學通訊工程系 教授

廖祥鑑   美商安矽思科技 資深應用工程師

蔡青霖   矽創科技 元件暨電磁設計處 處長

詹兆凱   台大電信所博士生(課程助教)
報名方式
如您對本課程有興趣,或需相關諮詢,請於下方留下您的聯絡資訊,我們將派專人與您聯繫,為您安排上課事宜,或回覆問題,感謝您!
備註
★請於課程網頁www.tl.ntu.edu.tw/training/→課程分類【智慧電子】線上報名。

★請務必填上公司名稱與正確可聯繫的Email和電話,確定開課將再發通知繳費。

★承辦人Email:lcyeh@tl.ntu.edu.tw
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