全數位鎖相迴路(ADPLL)設計實務及應用實例

開課日期:2019-12-07 課程費用:電洽
上課時間:假日 / 上午,下午 學習時程:12小時
上課地點: 新竹縣竹東鎮中興路4段195號21館 map
適用對象:
1.大專以上且理工相關科系畢業,具備電子學、硬體描述語言(HDL)、電路模擬(SPICE)等基礎觀...看完整
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課程特色
1.幫助學員瞭解全數位鎖相鎖相迴路的組成基本元件與動作原理,並結合數位與類比的混合式訊號模擬環境。
2.教導學員如何套用全數位鎖相迴路電路設計的相關知識到感測器與通訊電路等實務應用上。
詳細內容

系統單晶片(SOC)設計領域的必學議題 全數位鎖相迴路(ADPLL)系統單晶片不僅能處理數位訊號、類比訊號,而且能處理混合訊號甚至更高頻率的訊號。
本課程將從混合訊號的晶片設計流程出發,接著介紹
全數位鎖相迴路(All-Digital Phase-Locked Loop, ADPLL)所需的基礎設計方法與混合訊號(Mixed-Signal)的模擬環境。

知識的延伸與實務應用 延伸探討延遲鎖相迴路(DLL)、時間對數位轉換器(TDC)、溫度與電壓感測器、晶片參考時脈產生器與人體通道傳輸(BCC)的資料回復電路(CDR)設計之應用實例。

課程時間

課程大綱

108/10/19(六)

09:30~16:30

1.Introduction to Mixed-Signal IC Design Flow

2.Introduction to PLL/DLL

3.All-digital PLL Building Blocks (Digital Controlled Oscillator, Phase/Frequency Detector, Frequency Divider, PLL Controller, Loop Filter, PLL Loop Simulation)

4.All-digital DLL Building Blocks (Digital Controlled Delay Line, Phase Detector and Time-to-Digital Converter, DLL Controller and DLL Loop Simulation, Multi-phase Clock Generation)

5.Digital Modeling with Verilog

108/10/20(日)

09:30~16:30

6.Circuit Simulation with Fast-SPICE Simulator

7.AMS Simulation Flow (AMS Simulator (AMS-Ultra) and Virtuoso Platform, Prepare for AMS Simulation, AMS Simulation Flow)

8.Low-Voltage All-Digital Phase-Locked Loop

9.On-Chip Oscillators

10.Temperature/Voltage Sensors

11.Human Body Channel Communication Transceiver (Clock and Data Recovery Circuit)

 

師資介紹
工研院特聘專業講師
☀學歷:國立交通大學 電子研究所系統組 博士
☀專長:通訊與網路系統晶片設計、混合訊號積體電路設計、全數位鎖相迴路設計與應用研究等
☀研究成果:累計發表17篇有關全數位鎖相迴路、OFDM通訊系統、溫度感測器、固態硬碟磁碟陣列的 IEEE 期刊論文,和其他16 篇SCI期刊論文,並發表過兩篇 ISSCC 會議論文,及45篇其他國際會議論文。
報名方式
如您對本課程有興趣,或需相關諮詢,請於下方留下您的聯絡資訊,我們將派專人與您聯繫,為您安排上課事宜,或回覆問題,感謝您!
備註
課程諮詢專線:03-5913417 謝小姐
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