混合訊號式積體電路佈局與分析

開課日期:2019-04-30 課程費用:線上洽詢
上課時間:週二 / 晚上 學習時程:共21小時,18:30~21:30
上課地點: 新竹市大學路1001號交通大學工程四館教室 map
適用對象:
半導體產業暨相關系統業者之在職人員或有相關技術需求者
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課程特色
課程內容包括CMOS製程之主被動元件佈局,重點在於類比電路之佈局技巧,與寄生效應對混合訊號式積體電路之影響與分析,並講解電源線與訊號線分佈,與改善雜訊影響之技巧。
詳細內容

1. CMOS Processing Flow and Layout Design Rules

2. Layout Styles of MOS Transistors

3. Layout Styles of Resistors, Capacitors, and Inductors

4. Digital and Standard Cell Library Layout

5. Layout of Latch-Up and ESD

6. Analog Layout Considerations

7. Power Distribution and Signal-Integrity of Mixed-Signal IC

8. Noise Sources and Noise Reduction of Mixed-Signal IC

9. RF IC Layout

     10. Nanometer IC Layout

師資介紹

黃弘一 老師

現職國立台北大學電機工程所 副教授

經歷

工研院電通所課長
輔仁大學電子系副教授

Bio-circuits and Systems
Power Electronics
Low-Voltage Low-Power IC
High-Speed IC
Embedded Memory
Communication IC
Mixed-Signal IC Design and Layout

 

報名方式
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